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編輯推薦： 1.作者具有丰富的专用集成电路芯片的设计和验证经验。2.提供相应课件、习题以及案例库。3. 基于标准单元的数字IC开发流程进行章节安排。4. 根据实际设计案例描述相应的工具的使用细节与注意事项，使初学者能够熟练掌握EDA工具的基本使用。 內容簡介： 本书面向集成电路设计与集成系统、微电子科学与工程高年级本科生和相关专业低年级研究生以及有一定Verilog HDL语言基础，未来愿意从事数字IC设计的科技人员，针对基于标准单元的大规模数字集成电路设计，介绍自顶向下的设计方法和设计流程，用Verilog HDL描述数字集成电路时常用的规范、设计模式与设计方法，以及数字IC设计流程中Linux/Solaris平台上主流的EDA工具，包括：仿真工具NC-verilog/VCS、逻辑综合工具Design Compiler、静态时序分析工具PrimeTime、形式化验证工具Formality、工具命令语言TCL以及ICC编译工具等。本书内容按照基于标准单元的数字IC开发流程进行章节安排，包括EDA工具综述、可综合Verilog HDL子集、动态验证、EDA工具运行环境、UVM、逻辑综合、静态时序分析、形式化验证以及物理设计等，通过实际的工程例子说明设计规范和方法的使用，以及相应的EDA工具软件的使用细节与注意事项，力求使初学者能够熟练掌握Verilog HDL语言描述数字电路并初步掌握EDA工具的基本功能和使用。 關於作者： 杜慧敏， 西安邮电大学电子工程学院教授，副院长。2000年毕业于西北工业大学计算机系，获工学博士学位，方向超大规模集成电路设计与电子设计自动化。2001-2003年12月，华中科技大学博士后流动做博士后研究。曾在集成电路设计企业工作4年，从事通信专用集成电路芯片的设计和验证工作。现在西安邮电大学电子工程学院工作，硕士生导师。主要研究领域：SoC设计与验证、计算机系统结构等。曾经主持国家自然科学基金项目、陕西省科技攻关项目、西安市科技发展项目和多项企业委托项目。作为主要研究人员，参与国家自然科学基金项目、国家863项目、省部级项目、国家中小企业创新基金项目等多项。曾获得陕西省科技进步三等奖、陕西省教学改革成果一等奖。发表学术论文三十余篇，与他人合著专著一本、合作编写教材一本、工程参考书一本。是“计算机工程与工艺专委会”、“计算机容错专委会”、“计算机图形学专委会”委员，“电子设计工程”杂志编委，“计算机辅助设计与图形学学报”审稿人。目前为研究生开设“计算机图形学”，“微处理器设计”等课程。

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